[請益] 軟體轉DV請益

看板Tech_Job (科技人)作者 (阿亮)時間13小時前 (2025/12/29 09:49), 編輯推噓10(10018)
留言28則, 15人參與, 2小時前最新討論串1/1
各位版上的前輩好, 目前就讀於成大電機所資工組,實驗室方向主要是CV。有一些AI跟LLM相關的經驗,想請問 有機會轉Design Verification嗎? 考慮到AI/CS領域競爭激烈,想探索薪資底盤較高、更穩定的職業路徑。請問在研究所剩餘 的一年多時間,需要補哪些知識或做哪些專案,才比較有機會轉行?或是轉到IC相關領域的 可能性如何? 感謝各位前輩給點意見QQ -- ※ 發信站: 批踢踢實業坊(ptt.cc), 來自: 114.33.172.202 (臺灣) ※ 文章網址: https://www.ptt.cc/bbs/Tech_Job/M.1766972998.A.095.html

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三年前大徵才一定進的去 還在學校就可以
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去修課
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有修過IC相關的課了嗎
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有跟你教授談過了嗎? 如果你碩論跟IC
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無關那偏難
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主要是教授做的是純軟,跟ic無關 目
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前的想法是做個類似等級的事情放在git
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hub 但不確定有沒有效果
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學生的side project通常沒什麼參考性
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印在成績單上的課程甚至碩論才是真的
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先去修課吧 修完之後再考慮也不遲
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純軟可以做軟韌 dv差太多了
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可以做,肯學就可以
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study system verilog and UVM
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大公司不知道, 小公司一定有機會
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有認識成大EE控制組的去年進小新創DV
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12/29 12:23, 10小時前 , 17F
純軟跟DV很合阿,尤其是UVM
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有手肯學就能做了
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有cocotb在搞用python寫uvm
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只會寫uvm不會看waveform會變成掛了只
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會叫DE的廢物
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先去大學部,或跨所修相關的課程吧。搞不
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好一旁聽,就掛了。
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看波形感覺就好累 這工作是人做的嗎
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科技業黑手
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12/29 17:04, 6小時前 , 26F
uvm(SystemC)打開來一看 python
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12/29 19:00, 4小時前 , 27F
扛賽..
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12/29 20:06, 2小時前 , 28F
物件導向觀念好+略懂verilog就行了吧
12/29 20:06, 28F
文章代碼(AID): #1fKTv62L (Tech_Job)
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