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討論串[心得] IC驗證工程師工作經驗分享
共 6 篇文章
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在DV工作十年，算是一個里程碑？除了分享一些心得外，也再次推廣DV這個職務。 XD. 感謝遇到的所有長官、同事、還有各種機緣。. 先聲明，以下都是個人經驗分享，並非表示所有公司、部門狀況。. ======= 從抄自己的文章開始 =======. 以下 Digital Designer (簡稱DE).
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以下為代ＰＯ. 由於有看到有幾個大大在推文中說. 1.決定薪水主要是職等而不是職缺名字. 2.180是底, 不是頂. 是這樣得, 我會問這問題主要是因為最近認識一個外商驗證副總在說. uvm跟system verilog 不被他們公司重視. 甚至台灣的最高ＲＤ主管還說可以用FPGA驗 幹嘛還特地找s
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問一下. 這篇文章中說到 DV的薪水不輸DE. 因為驗證這塊要扛很大的責任 同時要懂的又很多知識與程式語言. 這邊的驗證指的是寫system verilog. 跟uvm 還有Perl的. 最近發現MTK的DE資深工程師可以到兩百五十萬年薪. 那DV也可以到這樣的年薪嗎？ 還是到一百八十萬就到頂了？.
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整理一下關於各位提出的問題. 1. DV的薪資條件如何. 這真的和公司/部門強相關. 在我工作的五年中 我和自己同學朋友DE比較過. 薪水是 >= DE. 不過這是我個人的經驗. 不代表所有公司/部門的情況. 2. 驗證只有產品出包才需要？. 這裡有個很簡單的問題. IC design在tapeou
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目前就業市場上是缺沒錯. 有專職 DV 的公司也偏大間, 例如幾家在台規模大的外商, 國內如 R,M,P,H. 至於薪水跟Digital engineer 差多少? 每家狀況不同, 有些差異沒很大. 選公司首重老闆的觀念. 如果老闆想法是沒 DV 照樣 tapeout. 那就你去明顯就是裝飾用的.
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